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[14]
2016 | Bielefelder E-Dissertation | PUB-ID: 2904773 OA
Sievers, G.: Entwurfsraumexploration eng gekoppelter paralleler Rechnerarchitekturen. Universität Bielefeld, Bielefeld (2016).
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[13]
2016 | Konferenzbeitrag | Veröffentlicht | PUB-ID: 2900363 OA
Flasskamp, M., Sievers, G., Ax, J., Klarhorst, C., Jungeblut, T., Kelly, W., Thies, M., Porrmann, M.: Performance Estimation of Streaming Applications for Hierarchical MPSoCs. Workshop on Rapid Simulation and Performance Evaluation: Methods and Tools (RAPIDO). p. 1. ACM Press, New York, NY (2016).
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[12]
2015 | Konferenzbeitrag | Veröffentlicht | PUB-ID: 2732427
Sievers, G., Ax, J., Kucza, N., Flasskamp, M., Jungeblut, T., Kelly, W., Porrmann, M., Rückert, U.: Evaluation of Interconnect Fabrics for an Embedded MPSoC in 28 nm FD-SOI. 2015 IEEE International Symposium on Circuits & Systems (ISCAS). p. 1925-1928. IEEE (2015).
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[11]
2015 | Konferenzbeitrag | Veröffentlicht | PUB-ID: 2760622
Sievers, G., Daberkow, J., Ax, J., Flasskamp, M., Kelly, W., Jungeblut, T., Porrmann, M., Rückert, U.: Comparison of Shared and Private L1 Data Memories for an Embedded MPSoC in 28nm FD-SOI. International Symposium on Embedded Multicore/Many-core Systems-on-Chip (MCSoC). p. 175-181. IEEE (2015).
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[10]
2015 | Report | PUB-ID: 2783874 OA
Ax, J., Flasskamp, M., Sievers, G., Klarhorst, C., Jungeblut, T., Kelly, W.: An Abstract Model for Performance Estimation of the Embedded Multiprocessor CoreVA-MPSoC Technical Report (v1.0). (2015).
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[9]
2015 | Konferenzbeitrag | Veröffentlicht | PUB-ID: 2783142 OA
Ax, J., Sievers, G., Flasskamp, M., Kelly, W., Jungeblut, T., Porrmann, M.: System-Level Analysis of Network Interfaces for Hierarchical MPSoCs. Proceedings of the 8th International Workshop on Network on Chip Architectures (NoCArc). p. 3-8. ACM, New York, NY, USA (2015).
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[8]
2014 | Konferenzbeitrag | Veröffentlicht | PUB-ID: 2698929
Hübener, B., Sievers, G., Jungeblut, T., Porrmann, M., Rückert, U.: CoreVA: A Configurable Resource-efficient VLIW Processor Architecture. Proceedings of the 12th IEEE International Conference on Embedded and Ubiquitous Computing. p. 9-16. IEEE (2014).
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[7]
2014 | Konferenzbeitrag | Veröffentlicht | PUB-ID: 2753235
Kelly, W., Flasskamp, M., Sievers, G., Ax, J., Chen, J., Klarhorst, C., Ragg, C., Jungeblut, T., Sorensen, A.: A Communication Model and Partitioning Algorithm for Streaming Applications for an Embedded MPSoC. International Symposium on System-on-Chip (SoC). IEEE, Tampere, Finland (2014).
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[6]
2013 | Konferenzbeitrag | Veröffentlicht | PUB-ID: 2576115 OA
Korf, S., Sievers, G., Ax, J., Cozzi, D., Jungeblut, T., Hagemeyer, J., Porrmann, M., Rückert, U.: Dynamisch rekonfigurierbare Hardware als Basistechnologie für intelligente technische Systeme. In: Gausemeier, J., Dumitrescu, R., Rammig, F., and Trächtler, A. (eds.) Proceedings Wissenschaftsforum 2013 Intelligente Technische Systeme. HNI-Verlagsschriftenreihe. 310, p. 79-90. Heinz-Nixdorf-Inst., Univ. Paderborn, Paderborn (2013).
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[5]
2013 | Konferenzbeitrag | Veröffentlicht | PUB-ID: 2637667
Sievers, G., Christ, P., Einhaus, J., Jungeblut, T., Porrmann, M., Rückert, U.: Design-Space Exploration of the Configurable 32 bit VLIW Processor CoreVA for Signal Processing Applications. 2013 NORCHIP. (2013).
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[4]
2013 | Konferenzbeitrag | Veröffentlicht | PUB-ID: 2634649
Christ, P., Sievers, G., Einhaus, J., Jungeblut, T., Porrmann, M., Rückert, U.: Pareto-optimal Signal Processing on Low-Power Microprocessors. Proceedings of the 12th IEEE International Conference on SENSORS. p. 1843-1846. IEEE (2013).
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[3]
2011 | Konferenzbeitrag | Veröffentlicht | PUB-ID: 2476993 OA
Jungeblut, T., Ax, J., Sievers, G., Hübener, B., Porrmann, M., Rückert, U.: Resource Efficiency of Scalable Processor Architectures for SDR-based Applications (Invited). Proc. of the Radar, Communication and Measurement Conference (RADCOM). (2011).
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[2]
2010 | Konferenzbeitrag | Veröffentlicht | PUB-ID: 2018549
Jungeblut, T., Sievers, G., Porrmann, M., Rückert, U.: Design Space Exploration for Memory Subsystems of VLIW Architectures. 5th IEEE International Conference on Networking, Architecture, and Storage. p. 377-385. (2010).
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[1]
2010 | Konferenzbeitrag | PUB-ID: 2286628 OA
Jungeblut, T., Lütkemeier, S., Sievers, G., Porrmann, M., Rückert, U.: A modular design flow for very large design space explorations. (2010).
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2016 | Bielefelder E-Dissertation | PUB-ID: 2904773 OA
Sievers, G.: Entwurfsraumexploration eng gekoppelter paralleler Rechnerarchitekturen. Universität Bielefeld, Bielefeld (2016).
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2016 | Konferenzbeitrag | Veröffentlicht | PUB-ID: 2900363 OA
Flasskamp, M., Sievers, G., Ax, J., Klarhorst, C., Jungeblut, T., Kelly, W., Thies, M., Porrmann, M.: Performance Estimation of Streaming Applications for Hierarchical MPSoCs. Workshop on Rapid Simulation and Performance Evaluation: Methods and Tools (RAPIDO). p. 1. ACM Press, New York, NY (2016).
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2015 | Konferenzbeitrag | Veröffentlicht | PUB-ID: 2732427
Sievers, G., Ax, J., Kucza, N., Flasskamp, M., Jungeblut, T., Kelly, W., Porrmann, M., Rückert, U.: Evaluation of Interconnect Fabrics for an Embedded MPSoC in 28 nm FD-SOI. 2015 IEEE International Symposium on Circuits & Systems (ISCAS). p. 1925-1928. IEEE (2015).
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2015 | Konferenzbeitrag | Veröffentlicht | PUB-ID: 2760622
Sievers, G., Daberkow, J., Ax, J., Flasskamp, M., Kelly, W., Jungeblut, T., Porrmann, M., Rückert, U.: Comparison of Shared and Private L1 Data Memories for an Embedded MPSoC in 28nm FD-SOI. International Symposium on Embedded Multicore/Many-core Systems-on-Chip (MCSoC). p. 175-181. IEEE (2015).
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2015 | Report | PUB-ID: 2783874 OA
Ax, J., Flasskamp, M., Sievers, G., Klarhorst, C., Jungeblut, T., Kelly, W.: An Abstract Model for Performance Estimation of the Embedded Multiprocessor CoreVA-MPSoC Technical Report (v1.0). (2015).
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2015 | Konferenzbeitrag | Veröffentlicht | PUB-ID: 2783142 OA
Ax, J., Sievers, G., Flasskamp, M., Kelly, W., Jungeblut, T., Porrmann, M.: System-Level Analysis of Network Interfaces for Hierarchical MPSoCs. Proceedings of the 8th International Workshop on Network on Chip Architectures (NoCArc). p. 3-8. ACM, New York, NY, USA (2015).
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2014 | Konferenzbeitrag | Veröffentlicht | PUB-ID: 2698929
Hübener, B., Sievers, G., Jungeblut, T., Porrmann, M., Rückert, U.: CoreVA: A Configurable Resource-efficient VLIW Processor Architecture. Proceedings of the 12th IEEE International Conference on Embedded and Ubiquitous Computing. p. 9-16. IEEE (2014).
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2014 | Konferenzbeitrag | Veröffentlicht | PUB-ID: 2753235
Kelly, W., Flasskamp, M., Sievers, G., Ax, J., Chen, J., Klarhorst, C., Ragg, C., Jungeblut, T., Sorensen, A.: A Communication Model and Partitioning Algorithm for Streaming Applications for an Embedded MPSoC. International Symposium on System-on-Chip (SoC). IEEE, Tampere, Finland (2014).
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2013 | Konferenzbeitrag | Veröffentlicht | PUB-ID: 2576115 OA
Korf, S., Sievers, G., Ax, J., Cozzi, D., Jungeblut, T., Hagemeyer, J., Porrmann, M., Rückert, U.: Dynamisch rekonfigurierbare Hardware als Basistechnologie für intelligente technische Systeme. In: Gausemeier, J., Dumitrescu, R., Rammig, F., and Trächtler, A. (eds.) Proceedings Wissenschaftsforum 2013 Intelligente Technische Systeme. HNI-Verlagsschriftenreihe. 310, p. 79-90. Heinz-Nixdorf-Inst., Univ. Paderborn, Paderborn (2013).
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2013 | Konferenzbeitrag | Veröffentlicht | PUB-ID: 2637667
Sievers, G., Christ, P., Einhaus, J., Jungeblut, T., Porrmann, M., Rückert, U.: Design-Space Exploration of the Configurable 32 bit VLIW Processor CoreVA for Signal Processing Applications. 2013 NORCHIP. (2013).
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2013 | Konferenzbeitrag | Veröffentlicht | PUB-ID: 2634649
Christ, P., Sievers, G., Einhaus, J., Jungeblut, T., Porrmann, M., Rückert, U.: Pareto-optimal Signal Processing on Low-Power Microprocessors. Proceedings of the 12th IEEE International Conference on SENSORS. p. 1843-1846. IEEE (2013).
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2011 | Konferenzbeitrag | Veröffentlicht | PUB-ID: 2476993 OA
Jungeblut, T., Ax, J., Sievers, G., Hübener, B., Porrmann, M., Rückert, U.: Resource Efficiency of Scalable Processor Architectures for SDR-based Applications (Invited). Proc. of the Radar, Communication and Measurement Conference (RADCOM). (2011).
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2010 | Konferenzbeitrag | Veröffentlicht | PUB-ID: 2018549
Jungeblut, T., Sievers, G., Porrmann, M., Rückert, U.: Design Space Exploration for Memory Subsystems of VLIW Architectures. 5th IEEE International Conference on Networking, Architecture, and Storage. p. 377-385. (2010).
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2010 | Konferenzbeitrag | PUB-ID: 2286628 OA
Jungeblut, T., Lütkemeier, S., Sievers, G., Porrmann, M., Rückert, U.: A modular design flow for very large design space explorations. (2010).
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